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Beratungs- und Entwicklungsleistungen für Chipverifikation und testgerechtes Design

Status
Vergeben
Angebotsfrist
27.07.2026, 11:00 (Europe/Berlin)
Geschätzter Wert
Nicht angegeben
Lose
2
Erfüllungsregion
Bayern, Deutschland
Verfahren
Offenes Verfahren
Auftragsart
Dienstleistung
Veröffentlicht
25.06.2026
CPV-Codes
Dienstleistungen im Bereich Forschung und experimentelle Entwicklung (73100000)
Bekanntmachung
deutsche-evergabe.de
Bekanntmachungsnummer
437282-2026
Verfahrensnummer
6b6c9f8a-6cda-4ca7-96a3-f31c5c590e62

Fragenkatalog

Deine Fragen an die Ausschreibung, beantwortet aus Bekanntmachung und Unterlagen.

Kurzbeschreibung

Die Fraunhofer-Gesellschaft zur Förderung der angewandten Forschung e. V. sucht Unterstützung für zwei Cybersicherheitsprojekte zur Entwicklung von Test- und Verifikationskonzepten für Chips. Die beiden Lose umfassen den Aufbau von Testumgebungen und die Prüfung der Chipfunktionen sowie die Entwicklung einer Strategie für Design-for-Test, also die Berücksichtigung der Testbarkeit bereits beim Chipdesign. Die Projekte werden in Erlangen-Tennenlohe betreut; dort ist ein Treffen pro Quartal vorgesehen.

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Leistungsbeschreibung

The two projects named above are cyber-security applications to fullfill requirements for the European Cyber-Security-Act. They will be developed in 22 nm FD-SOI silicon technology and beyond. To assure testability on block level up to system on chip top level, a strategy for DFT insertion and simulation must be developed and implemented. Therefore, one meeting per quarter shall be performed at the Fraunhofer Institute for Integrated Circuits in Erlangen-Tennenlohe. Furthermore, flexibility of working hours is required in order to be able to react promptly to urgent adjustments.

Leistungen nach Losen (2)

  • LOT-0001 · Lot 1: Functional Verification

    The following tasks are initially planned: • Setup of verification environment, server and simulation tool infrastructure • Familiarization with the design functionalities algorithms, structure and design hierarchy • Setup of test plans for hierarchical block level verification with UVM • Continuous development of testcases and execution of simulations, analysis and documentation of the verification results, support of bug fixing with the IIS design team • The progress and results of the described tasks will be the starting point for the definition of the following work III. Essential requirements • At least 10 years of experience in digital functional verification • At least 10 years of experience using standard functional verification and simulation tools from major providers like Synopsys, Cadence or Siemens-Mentor • At least 10 years of experience of setting up and use of verification environments and regression suites • Deep knowledge and experience in UVM verification methodology • Excellent analysis and documentation skills • Business fluent in German and English

    Frist: 27.07.2026, 02:00 (Europe/Berlin)

  • LOT-0002 · Lot 2: Design for Test

    The following tasks are initially planned: • Setup of DFT environment for implementation and simulation with Cadence or Siemens EDA depending on the projects requirements o E.g. JTAG, MBIST, SCAN,… • Defining a DFT strategy for the individual projects • Familiarization with the project’s functionality, structure and design hierarchy • Continuous and iterative improvement of the test coverage • The progress and results of the described tasks will be the starting point for the definition of the following work III. Essential requirements • At least 10 years of experience in complex digital Design-for-Test • At least 10 years of experience in developing a proper Test strategy with Frontend Designers • In-depth knowledge about the different Test capabilities • Excellent analysis and documentation skills • Business fluent in English, German is a plus

    Frist: 27.07.2026, 02:00 (Europe/Berlin)

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Wie wird das Angebot bewertet?

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Presence of professional knowledge
40 %
Evaluation of comparative projects
25 %
price
35 %
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40 %
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Vergabeunterlagen

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Änderungen und Bieterfragen

1 Eintrag
  1. 07.10.2026VergabebekanntmachungBekanntmachung 690423-2026

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